이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
실리콘 테스트와 디버깅에 대한 경험은 학교 FPGA 실습에서 설계한 로직이 예상대로 동작하지 않을 때 디버깅하는 과정을 통해 간접적으로 쌓았습니다. 시뮬레이션에서는 통과했지만 하드웨어에서 오류가 발생하는 상황을 경험하면서, 시뮬레이션과 실제 동작 사이의 차이가 존재한다는 것을 이해했습니다. 로직 애널라이저로 신호 타이밍을 캡처하고 비교하는 방법을 배웠습니다. 실제 ASIC 테스트 경험은 없지만, 테스트 방법론(BIST, Scan Chain, ATE 활용)을 이론으로 이해하고 있습니다.
반도체 테스트는 결함 커버리지와 테스트 비용 사이의 균형을 설계 단계부터 고려한다는 것도 배웠습니다. 테스트 가능성(Testability)을 설계에서부터 고려하는 것이 칩 개발 효율을 높이는 핵심이라고 이해하고 있습니다.
FPGA 실습에서 RTL 시뮬레이션은 통과했는데 실제 보드에서 오작동이 생긴 경험이 있습니다. 클럭 주파수를 높여서 테스트했을 때 특정 연산 결과가 간헐적으로 틀린 값이 나왔습니다. 로직 애널라이저로 파형을 확인했을 때 셋업 타임 위반이 원인이었습니다. 시뮬레이션은 이상적인 타이밍 가정으로 돌아가는데, 실제 배선 지연이 추가되면서 마진이 없어진 것이었습니다. 그때부터 타이밍 리포트를 습관적으로 확인하게 됐고, Slack이 음수인 경로를 먼저 체크하는 루틴을 만들었습니다. 시뮬레이션과 실리콘 동작이 다를 수 있다는 걸 직접 손으로 확인하기 전까지 체감하기 어렵다는 것도 배웠습니다. 디버깅은 도구를 아는 것보다 무엇을 측정해야 하는지 아는 것이 먼저라고 봅니다.
전자회로 실험에서 오류가 간헐적으로 나타나는 경우를 처음 맡았을 때, 재현 조건을 찾는 것 자체가 디버깅의 절반이었습니다. 같은 입력을 줬는데 열 번 중 두세 번만 잘못된 출력이 나왔습니다. 처음에는 측정 장비 문제라고 생각했는데, 온도와 전압 변동을 함께 기록하면서 패턴이 보이기 시작했습니다. 특정 온도 이상에서 발생 빈도가 올라갔고, 부품 스펙이 동작 온도 범위 끝에서 마진이 줄어들기 때문이었습니다.
재현 조건이 없으면 수정이 맞는지 확인할 수 없다는 것을 그때 배웠습니다. 이후에는 디버깅 시작 전에 언제, 어떤 조건에서 발생하는지를 먼저 기록하는 단계를 넣는 습관이 생겼습니다. 간헐적 오류는 재현 가능한 오류보다 해결하는 데 시간이 더 걸린다는 걸 그 경험에서 배웠습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 HD현대마린솔루션 공통직무·미지정 면접관이 던질 가능성이 높은 후속 질문.
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