이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
학부 프로젝트에서 DDI(Display Driver IC)의 타이밍 제어기 RTL 구현에 참여했습니다. 디스플레이 패널로 가는 신호의 Hsync·Vsync 타이밍과 데이터 유효 구간을 정확하게 제어하는 게 핵심이었습니다. MIPI DSI 프로토콜 스펙을 보면서 LP/HS 모드 전환 타이밍을 RTL로 구현했고, 처음엔 전환 시점에서 글리치가 발생했습니다.
전환 조건을 상태 머신으로 명확하게 정의하고 나서 글리치가 사라졌습니다. 디스플레이 인터페이스는 타이밍 마진이 매우 좁아서 레지스터 경계 조건 하나가 화면 이상으로 나타날 수 있다는 걸 배웠습니다. 이후 저는 타이밍 제어 설계를 볼 때 상태 전환 조건부터 먼저 확인하는 습관이 생겼습니다.
DDI 관련 수업에서 감마 보정(Gamma Correction)이 디스플레이 색상 품질을 결정하는 핵심 요소라는 것을 배웠습니다. 픽셀 데이터가 선형 스케일로 들어오면 패널의 비선형 응답 특성 때문에 실제 표시 밝기가 입력값과 달라지는 현상이 생깁니다.
감마 룩업 테이블(LUT)을 설계 단계에서 패널 특성에 맞게 조정하지 않으면 색 재현율이 낮아지고 그라데이션이 부자연스럽게 보입니다. LUT 값을 계산할 때 패널 RC 지연도 함께 고려해야 한다는 것을 과제에서 배웠습니다. 게이트 드라이버 출력 슬루율이 너무 느리면 픽셀 응답이 둔해지고, 너무 빠르면 전력이 올라가는 트레이드오프가 있다는 것도 이때 배웠습니다.
DDI 설계는 디지털 제어와 아날로그 특성을 함께 보는 혼합 신호 설계라는 것이 핵심 인상이었습니다.
DDI 수업에서 MIPI DSI 프로토콜의 LP 모드와 HS 모드 전환 조건이 얼마나 엄격한지를 알게 됐습니다. 전환 타이밍이 조금이라도 벗어나면 호스트와 패널 사이에 동기화 오류가 생기고 화면이 깜빡이거나 꺼지는 현상이 나타납니다. 시뮬레이션에서 THS-PREPARE와 THS-ZERO 타이밍을 각각 스펙 최솟값으로 설정했을 때, 패널이 HS 모드 진입을 인식하지 못하는 케이스가 나왔습니다.
타이밍 파라미터는 최솟값이 아니라 여유를 둔 값으로 설계하는 것이 실제 운영에서 안전하다는 것을 배웠습니다. 마진 없이 스펙 경계에서 설계하면 공정 변동이나 온도 변화에 취약합니다. 검증에서 엣지 케이스를 먼저 확인하는 습관이 DDI 프로젝트에서 생겼습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 DB그룹 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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