이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
ESD 소자 불량 분석은 소자 설계 수업에서 이론을 접하고, 인턴 중 실제 불량 샘플로 분석 과정을 경험했습니다. 전기적 특성 측정에서 I-V 커브 이상이 발견되면 그 모양이 저항성 단락인지 접합 열화인지 구분하는 게 첫 단계입니다. TLP(Transmission Line Pulse) 테스트 결과로 소자가 ESD 전류를 어느 레벨까지 버텼는지 확인하고, 불량이 확인되면 단면 SEM·TEM 분석으로 게이트 산화막이나 메탈 배선의 물리적 손상 위치를 찾았습니다.
ESD 전류 경로를 추적할 때는 레이아웃 위에 전류가 집중되는 부위를 시뮬레이션으로 사전 예측해두면 물리 분석 위치를 좁히는 데 도움이 됐습니다. 이 과정에서 전기 측정과 물리 분석을 같이 봐야 원인을 제대로 특정할 수 있다는 것을 실감했습니다.
ESD 소자 불량 분석에서 제가 짜는 절차의 핵심은, 인체 모델과 충전 소자 모델 같은 테스트 모드별로 불량 메커니즘이 달라 구분 진단하는 일입니다. 두 모드는 전류 파형과 손상 양상이 달라, 어느 모드에서 깨졌는지를 가르지 않으면 엉뚱한 곳을 들여다보기 때문입니다. 그래서 저는 전기 측정에서 I-V 커브 이상이 저항성 단락인지 접합 열화인지를 먼저 구분하고, TLP 측정으로 소자가 ESD 전류를 어느 레벨까지 버텼는지와 클램핑 전압을 확인합니다. 그다음 손상 위치를 좁혀 단면 SEM·TEM으로 게이트 산화막이나 메탈 배선의 물리적 손상을 검증합니다. 막힌 자리도 짚습니다. 전기 측정만으로는 손상 위치를 못 좁혀, 레이아웃 위 전류 집중 부위를 시뮬레이션으로 사전 예측해 물리 분석 위치를 줄여야 했습니다. 다만 저는 소자 설계 수업과 인턴 분석 보조 수준이라, 기생 성분이 클램핑 성능에 미치는 영향을 SPICE로 분석해 설계 단계에서 불량을 예방해 본 경험은 없습니다. 그래서 모드 구분 절차를 토대로, 그 분석 역량을 더 키우려 합니다.
ESD 소자 불량 분석에서 제가 직접 익힌 건, 전기 측정과 물리 분석을 따로 보지 않고 함께 봐야 원인을 제대로 특정한다는 점입니다. 인턴 때 실제 불량 샘플을 분석하며, 전기 특성에서 I-V 커브 이상만 보면 어디가 어떻게 깨졌는지는 모르고, 단면 분석만 하면 어느 동작에서 깨졌는지를 모르기 때문입니다. 그래서 저는 TLP 테스트로 소자가 ESD 전류를 어느 레벨까지 버텼는지를 전기적으로 확인하고, 불량이 확인되면 단면 SEM·TEM으로 게이트 산화막이나 메탈 배선의 물리적 손상 위치를 찾아 둘을 맞췄습니다. 전류 경로를 추적할 땐 레이아웃 위 전류 집중 부위를 시뮬레이션으로 사전 예측해 물리 분석 위치를 좁혔습니다. 재발 방지로는 이 절차를 분석 순서로 남겼습니다. 다만 한계도 짚습니다. 저는 수업과 인턴 보조 수준이라, EMMI나 OBIRCH로 손상 위치를 정밀 식별하거나 그 결과를 설계 예방으로 연결해 본 경험은 없습니다. 그래서 전기·물리를 함께 본 경험을 토대로, 그 분석 역량을 더 키우려 합니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 DB그룹 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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