이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
학부에서 에뮬레이터에 RTL을 올려보는 과정에서, 에뮬레이션 호환 설계가 왜 중요한지를 직접 겪었습니다. 처음 작성한 RTL에 initial 블록과 $display가 남아 있어서 에뮬레이터가 컴파일을 거부했습니다. 수정 후 올렸을 때 시뮬레이션에서 잡지 못한 타이밍 이슈가 에뮬레이션에서 바로 드러났습니다. 에뮬레이터는 실리콘에 가까운 속도로 동작하기 때문에 시뮬레이션에서 안 보이던 레이스 컨디션이 나타날 수 있다는 걸 배웠습니다.
에뮬레이션 호환 스타일로 처음부터 짜는 것이 나중에 포팅 비용을 줄인다는 걸 그 경험에서 알았습니다. 설계 초반부터 에뮬레이션 제약을 의식하면 실리콘 전달 후 디버그 사이클이 줄어든다는 걸 배웠습니다. 이후 저는 RTL을 작성할 때 합성 가능 여부를 코딩 단계부터 고려하는 습관이 생겼습니다.
에뮬레이션 호환 RTL의 중요성을, 저는 검증 속도와 코너 케이스 재현이라는 두 결로 나눠 봅니다. 에뮬레이터는 실리콘에 가까운 속도로 동작해, 시뮬레이션으론 너무 느려 못 돌리는 긴 시나리오를 검증할 수 있고, 그 빠른 동작에서 시뮬레이션에선 안 보이던 레이스 컨디션 같은 코너가 드러나기 때문입니다. 그래서 저는 에뮬레이션 호환 설계가 단순 호환을 넘어, 빠른 검증과 코너 재현이라는 실익을 준다고 봅니다. 다만 트레이드오프도 짚습니다. 에뮬레이션은 합성 가능한 코드만 받아 시뮬레이션의 풍부한 디버그 가시성을 일부 포기해야 하고, 속도와 정확도 사이에서 무엇을 우선할지 결정해야 합니다. 검증으로는 시뮬레이션·에뮬레이션·실리콘이 각자 잡는 결이 달라 함께 가야 합니다. 다만 본인 사례와 한계를 짚습니다. 저는 학부에서 RTL을 에뮬레이터에 올려 본 수준이라, 클록 파티셔닝이나 BFM 계층 분리로 포팅 비용을 줄이는 시니어 수준의 설계는 다뤄 보지 못했습니다. 그래서 속도·재현을 분별하는 시각을 토대로, 그 설계 역량을 더 키우려 합니다.
에뮬레이션 호환 RTL의 중요성을 제가 직접 겪은 건, 학부에서 RTL을 에뮬레이터에 올리며 합성 불가 구문을 제거한 일입니다. 처음 작성한 RTL에 initial 블록과 $display가 남아 에뮬레이터가 컴파일을 거부했고, 수정해 올렸더니 시뮬레이션에서 못 잡은 타이밍 이슈가 에뮬레이션에서 바로 드러났기 때문입니다. 그래서 저는 에뮬레이션 호환 스타일로 처음부터 짜는 게 나중에 포팅 비용을 줄인다는 걸 알았고, 이후 RTL을 쓸 때 합성 가능 여부를 코딩 단계부터 고려하는 습관이 생겼습니다. 트레이드오프도 짚습니다. 합성 가능한 코드만 쓰면 디버그용 구문을 못 써 시뮬레이션의 가시성을 일부 포기하게 됩니다. 다만 한계도 짚습니다. 저는 학부 수준이라, 클록 도메인 교차를 명시적으로 설계하거나 에뮬레이션 속도와 시뮬레이션 정확도의 트레이드오프를 실제 프로젝트에서 결정해 본 경험은 없습니다. 그래서 합성 불가 구문을 제거한 경험을 토대로, 그 설계 역량을 더 키우려 합니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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