이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
RTL 설계 실습에서 통합 후 시뮬레이션에서야 CDC 오류를 발견한 경험이 있습니다. 블록 단계에서 CDC 검사를 하지 않았더니 통합 후 수정 비용이 블록 단계의 몇 배가 됐습니다. 그 이후로는 블록 설계가 완료되는 시점에 Lint와 CDC 검사를 루틴으로 실행합니다. Lint는 합성 불가 구문, 미사용 신호, 래치 추론 같은 코딩 규칙 위반을 잡고, CDC는 클록 도메인 경계를 넘는 신호의 동기화 누락을 검출합니다. 검사 결과는 심각도로 분류해 에러는 즉시 수정하고 경고는 의도한 것인지 주석으로 표시합니다. 이 루틴을 적용한 뒤 통합 단계 CDC 관련 오류가 없었습니다. 지금도 Lint·CDC는 통합 전 체크포인트로 씁니다.
Lint·CDC 검사에서 오류보다 경고 처리가 더 어렵다는 것을 경험했습니다. 에러는 수정하면 되지만, 경고를 무시해도 되는지 아니면 잠재적 문제인지를 판단하는 것은 설계 의도를 알아야 가능합니다. CDC 검사에서 동기화기(Synchronizer)가 이미 상위에서 처리됐지만 도구가 해당 경로를 알지 못해 경고를 내는 경우가 있었습니다.
이 경우 Waiver를 적용하되 근거를 주석으로 남겨야 나중에 다른 사람이 그 결정을 이해할 수 있습니다. Waiver를 남용하면 실제 문제도 묻혀버리기 때문에, 예외 적용 시마다 동기화 경로를 직접 확인하는 것이 기준입니다. 경고 처리는 도구를 믿는 것과 설계 의도를 아는 것 사이의 균형입니다.
RTL 설계 실습에서 Lint 검사가 잡아낸 래치 추론 오류가 타이밍 문제로 이어지는 과정을 경험했습니다. always 블록에서 조건 분기가 불완전해 일부 입력 조건에서 레지스터가 아닌 래치가 생성되는 결과가 나왔습니다. Lint 래치 인퍼런스 경고를 무시하고 넘어갔다가 시뮬레이션에서 특정 케이스가 간헐적으로 실패하는 문제가 생겼고, 원인을 역추적하는 데 한참 걸렸습니다.
경고를 경고로 남기는 것은 시간을 뒤로 미루는 것이라는 것을 그때 배웠습니다. 이 경험에서 Lint는 합성 후 디버깅보다 훨씬 빠른 위치에서 문제를 잡아준다는 것을 이해했습니다. 정적 분석 경고는 합성 전에 처리하는 것이 가장 효율적인 이유가 여기에 있습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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