이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
복잡한 ASIC 및 인터포저 설계에서 PPA 최적화의 핵심은 인터포저 배선의 기생 성분이 신호 타이밍과 전력에 미치는 영향을 설계 초기부터 반영하는 것입니다. 인터포저 경유 신호는 온칩 배선보다 저항·캐패시턴스가 크기 때문에 같은 타이밍 목표라도 더 강한 드라이버가 필요합니다.
수업에서 인터포저 기반 2.5D 패키징 설계의 전력 분석을 다뤘습니다. 다이 간 신호가 인터포저를 지날 때 발생하는 동적 전력이 예상보다 크게 나오는 케이스를 분석하면서, 마이크로범프 수와 신호 스윙 폭이 전력에 미치는 영향을 파악했습니다.
PPA 최적화에서 배운 것은 ASIC과 인터포저를 별도로 최적화하면 통합 후 목표를 달성하기 어렵다는 점입니다. 두 레이어의 설계 제약을 동시에 고려하는 코-최적화 접근이 통합 후 재작업을 줄이고 PPA 목표 달성 확률을 높입니다.
학부 합성 최적화 과제에서 첫 실행한 합성 결과를 그대로 제출하려다가, 같은 조건으로 한 번 더 돌렸을 때 면적 수치가 소폭 달라지는 경우를 발견했습니다. 합성 도구가 내부적으로 휴리스틱을 쓰기 때문에 실행마다 결과가 조금씩 달라질 수 있다는 걸 알았습니다.
3번 실행 결과를 비교해 수치 분산이 작은 설정 조건을 선택했습니다. 제출 전에 결과의 안정성을 확인하는 것이 검증의 일부라는 걸 그때 배웠습니다. PPA 수치는 한 번 실행 결과보다 여러 번 실행한 평균과 분산으로 보는 것이 더 신뢰도가 높습니다. 검증은 결과를 얻는 것과 결과가 bff을 만한지 확인하는 것 두 단계입니다. 이 경험에서 PPA 최적화 결과는 재현 가능한지 확인하는 과정까지 포함되어야 한다는 걸 배였습니다.
학부 ASIC 합성 과제에서 타이밍 목표(500MHz)와 면적 목표(1.2mm²)를 동시에 만족시키는 조건을 찾으려 했습니다. 타이밍 목표를 달성하려 하면 면적이 예산을 초과하고, 면적을 줄이면 타이밍이 무너졌습니다. 두 목표가 충돌하는 구간이 있었습니다.
타이밍 목표를 5% 완화했을 때 면적이 예산 안으로 들어왔습니다. 두 조건을 모두 만족시키는 설정이 없을 때는 어느 쪽을 우선할지 기준이 필요합니다. 저는 설계 요구사항 우선순위를 다시 확인하고 타이밍 완화를 선택했습니다. PPA 최적화는 세 가지를 동시에 올리는 게 아니라 제약 안에서 균형점을 찾는 것입니다. 이 경험에서 PPA 최적화의 본질은 어떤 축을 얼마나 양보할지 판단하는 것임을 배였습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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