이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
인터페이스 설계 수업에서 MIPI와 DFI를 처음 배울 때 신호가 많아 한 번에 이해하기 어려웠습니다. 각 프로토콜의 핵심 트랜잭션 시퀀스를 타이밍 다이어그램으로 직접 그려보니 구조가 잡혔습니다. MIPI D-PHY는 LP 모드와 HS 모드 전환 시퀀스가 핵심이고, DFI는 컨트롤러와 PHY 사이 타이밍 정렬이 성능을 결정합니다.
DFI 타이밍 파라미터 오설정으로 쓰기 레이턴시가 맞지 않는 시뮬레이션 오류를 직접 디버깅한 경험이 있습니다. 스펙에서 각 파라미터의 정의를 다시 확인하고 값을 조정해 해결했습니다. 타이밍 다이어그램을 스펙에서 직접 읽는 습관 덕분에 디버깅 속도가 빨라졌습니다. 지금도 새 인터페이스는 핵심 트랜잭션 흐름부터 파악합니다.
MIPI와 DFI를 배우면서 프로토콜 스펙을 이해하는 것과 실리콘에서 구현 제약을 다루는 것은 다른 수준이라는 것을 알게 됐습니다. 스펙에서 정의된 DFI tDFIRDDATA 파라미터는 타이밍 정의가 명확하지만, 실제 PHY에서 캘리브레이션 훈련 시퀀스 없이는 이 값이 PVT 조건마다 달라지는 것을 확인했습니다. 스펙을 읽을 때 각 파라미터가 '어떻게 측정되는지'와 '누가 보장하는지'를 함께 파악하면 스펙과 구현 사이의 간극이 어디에 있는지를 알 수 있습니다.
스펙의 타이밍 파라미터는 조건을 명시한 상태에서만 유효한 숫자입니다. 이 인식이 신규 프로토콜을 처음 볼 때 스펙 숫자보다 조건 정의를 먼저 확인하는 습관으로 이어졌습니다. 프로토콜 이해는 스펙을 읽는 것에서 시작해 구현 제약을 가늠하는 것으로 완성됩니다.
MIPI D-PHY와 C-PHY의 차이를 공부하면서 같은 MIPI 계열이라도 물리 계층 구조가 다르면 타이밍 모델이 완전히 달라진다는 것을 배웠습니다. D-PHY는 차동 쌍(DP/DN)으로 데이터를 전송하지만, C-PHY는 3선 방식으로 인코딩하기 때문에 같은 주파수에서도 데이터 전송량이 다릅니다. 심볼 전송율(Symbol Rate)이 C-PHY에서 더 중요한 지표가 되는 이유가 여기에 있습니다.
인터페이스를 이해할 때 프로토콜 이름보다 물리 계층의 동작 방식을 먼저 구분하는 것이 혼동을 줄입니다. 이 경험에서 새 인터페이스를 볼 때 PHY 물리 계층부터 파악하는 순서를 익혔습니다. MIPI 계열 지식은 공통 부분과 변형 부분을 분리하는 시각에서 넓어집니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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