이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
학부 VLSI 설계 수업에서 오픈소스 OpenSTA 도구로 정적 타이밍 분석을 처음 실습했습니다. 셋업 타이밍 리포트에서 크리티컬 패스와 슬랙 값을 읽고 어느 게이트에서 지연이 집중되는지 파악하는 방법을 배웠습니다. 클럭 제약을 SDC 파일로 작성하면서 클럭 주기와 입출력 지연 제약이 리포트 결과에 어떤 영향을 주는지 직접 확인했습니다. 슬랙이 음수로 나올 때는 해당 경로의 논리 깊이를 줄이거나 셀 드라이브 강도를 높이는 방향으로 수정했고, 수정 전후 슬랙 변화를 비교하면서 개선 효과를 검증했습니다.
홀드 위반은 셋업 위반과 수정 방향이 반대여서 처음에 혼동하기도 했는데, 이 차이를 이해하면서 타이밍 수정의 기본 개념이 자리잡혔습니다. 이 실습이 상용 STA 도구의 리포트 구조를 이해하는 기반이 됐습니다.
학부 실습에서 OpenSTA로 합성 후 넷리스트 타이밍 분석을 했을 때 슬랙이 양수로 나왔습니다. 그런데 P&R 이후 다시 STA를 돌렸더니 같은 경로에서 슬랙이 음수로 바뀌었습니다. 합성 단계의 넷리스트에는 배선 지연(RC 기생 성분)이 추출되지 않았기 때문에, P&R 이후의 기생 성분이 타이밍에 추가로 영향을 준 것이었습니다. OpenSTA는 기본적으로 배선 지연을 와이어 모델로 추정하는데, 실제 P&R 기생 성분과 차이가 났습니다.
합성 후 STA 결과는 P&R 이후 결과를 보장하지 않는다는 걸 그때 배웠습니다. STA 도구는 어느 단계 넷리스트를 입력으로 쓰느냐에 따라 결과가 달라집니다. 이 경험에서 STA 결과는 어떤 기생 성분 모델이 사용됐는지를 확인하고 해석해야 한다는 걸 배웠습니다.
학부에서 오픈소스 OpenSTA로 STA 실습을 했는데, 인턴 때 상용 환경의 타이밍 리포트를 처음 받았습니다. 도구가 달랐지만 크리티컬 패스·슬랙·클럭 스큐·홀드 위반의 개념은 동일했습니다. OpenSTA에서 SDC 파일로 클럭 제약을 작성했던 경험이 있어서 상용 환경의 SDC 문법도 빠르게 읽을 수 있었습니다. 분석 절차 — 크리티컬 패스 확인 → 슬랙 음수 경로 추적 → 셀 선택 조정 — 도 동일하게 적용했습니다.
도구 이름이 달라도 STA의 본질은 같습니다. STA 도구를 바꿔도 기본 분석 방법이 살아있으면 적응이 빠릅니다. 이 경험에서 STA 역량은 특정 도구 사용법이 아니라 타이밍 분석 개념에 있다는 걸 배웠습니다. 개념이 먼저이고 도구는 그 다음입니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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