이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
평면 MOSFET 제작에 사용되는 주요 기술은 포토리소그래피, 이온 주입, 열처리, 게이트 산화, 금속 배선 단계로 구성됩니다. 게이트 절연막 형성에서는 산화 공정의 균일도와 두께 제어가 전기적 특성을 결정하고, 소스·드레인 이온 주입 후 활성화 어닐링 조건이 접합 깊이와 저항에 영향을 줍니다.
상호 연결에서는 텅스텐 플러그와 Cu 다마신 공정이 각 레이어에서 접촉 저항과 RC 지연을 결정하는 핵심 단계입니다. 미세 노드로 갈수록 상호 연결의 RC 지연이 성능 제한 요소가 되고, 에어갭이나 저유전율 ILD 재료 도입이 이를 개선하는 방향입니다. 이 공정 흐름을 교과서와 실습을 통해 공부했고, 현장에서 직접 경험하고 싶습니다.
평면 MOSFET 공정에서 직접 손에 닿은 경험과 이론으로만 아는 것을 구분하면 실험 실습에서 이온 주입 이후 활성화 어닐링 단계까지 직접 수행해봤습니다. 어닐링 온도와 시간이 접합 깊이에 영향을 준다는 것을 측정 데이터로 확인한 경험이 있습니다. 시뮬레이션 예측과 실측 결과가 다소 달랐고, 그 차이가 확산 계수 모델의 한계 때문이라는 설명을 교수님께 들었습니다. STI·게이트 산화·Cu 다마신은 강의와 문서로만 공부했기 때문에 어느 단계에서 파라미터가 어떻게 움직이는지는 이론 수준입니다.
직접 경험한 단계와 학습한 단계를 솔직히 구분하는 것이 정확한 자기 평가라고 생각합니다.
MOSFET 공정 이해를 심화하기 위해 직접 경험이 없는 부분을 어떻게 채울지를 생각하고 있습니다. 특히 STI 형성과 게이트 산화막 두께 제어는 Vth와 게이트 누설 전류에 직결되는 단계인데, 이론으로 이해했지만 실측 경험은 없습니다. 인턴십이나 실험 장비가 있는 연구실에서 이 단계를 직접 경험하고 싶고, 공정 파라미터 변동이 소자 특성에 미치는 영향을 데이터로 확인하는 것이 다음 목표입니다. 이론을 알고 있는 상태에서 실측 경험이 더해지면 공정 통합 시 발생하는 인터페이스 문제를 예측하는 능력이 생길 것이라 생각합니다.
다음 단계에서 무엇을 해야 하는지가 명확할 때 현장 진입 후 성장 속도가 빠르다고 믿습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 공정기술 면접관이 던질 가능성이 높은 후속 질문.
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