이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
시뮬레이션 시간을 줄이기 위해 시도한 방식은 학부 프로젝트에서 회귀 테스트 실행 시간이 너무 길어 개발 주기가 느려진 문제에서 출발했습니다. 처음 시도한 것은 독립적인 테스트 케이스를 병렬로 실행하는 구조였고, 실행 시간이 약 60% 줄었습니다. 전체 시뮬레이션 시간 중 웨이브폼 덤프 비중이 크다는 것을 프로파일링으로 확인했고, 이후 디버그 목적이 있는 케이스에만 선택적으로 덤프를 남기는 방식으로 바꿨습니다.
VCD 대신 FSDB 포맷을 쓰면 파일 크기와 덤프 시간이 줄어든다는 것도 이 과정에서 배웠습니다. 테스트 케이스를 분할해 작은 단위의 빠른 케이스부터 실행하면 회귀 실패를 더 일찍 발견할 수 있습니다. 이 경험에서 시뮬레이션 인프라 최적화가 개발 속도에 직접 영향을 준다는 것을 실감했습니다.
시뮬레이션 시간을 줄일 때 제가 의식하는 절차는, 매번 전체 회귀를 다 돌리지 않고 변경 영향 범위를 분석해 최소 필요한 회귀 세트만 돌리는 일입니다. 한 블록만 바뀌었는데 전체를 재시뮬레이션하면 시간이 낭비되는데, 변경이 닿는 범위만 골라 돌리면 사이클이 크게 줄기 때문입니다. 그래서 저는 점진적 컴파일로 변경된 블록만 재시뮬레이션하고, 변경과 무관한 시나리오는 빼는 식으로 접근하는 게 핵심이라고 봅니다. 본인 손에 닿은 자리로는, 학부 프로젝트에서 회귀 시간이 길어 독립 테스트를 병렬 실행해 시간을 약 60% 줄인 경험이 있습니다. 재발 방지로는 작은 단위의 빠른 케이스부터 실행해 회귀 실패를 일찍 발견하는 방식을 남겼습니다. 다만 한계도 짚습니다. 저는 학부 수준이라, 에뮬레이션이나 FPGA 프로토타이핑으로 검증을 실리콘 속도에 가깝게 올리거나 변경 영향을 정밀하게 분석해 회귀 세트를 동적으로 선정해 본 경험은 없습니다. 그래서 영향 범위로 회귀를 줄이는 절차를 토대로, 그 역량을 더 키우려 합니다.
시뮬레이션 시간을 줄이려고 제가 직접 한 건, 웨이브폼 덤프를 선택적으로 제어한 일입니다. 학부 프로젝트에서 회귀 시간이 너무 길어 개발 주기가 느려졌는데, 프로파일링해 보니 전체 시간 중 웨이브폼 덤프 비중이 컸기 때문입니다. 그래서 저는 디버그 목적이 있는 케이스에만 선택적으로 덤프를 남기도록 바꿨고, VCD 대신 FSDB 포맷을 쓰면 파일 크기와 덤프 시간이 줄어든다는 것도 그때 배웠습니다. 본인 손에 닿은 자리로는, 그 전에 독립 테스트를 병렬 실행해 시간을 약 60% 줄인 것도 함께 했습니다. 재발 방지로는 테스트를 분할해 작은 빠른 케이스부터 돌려 회귀 실패를 일찍 발견하는 방식을 남겼습니다. 시뮬레이션 인프라 최적화가 개발 속도에 직접 영향을 준다는 걸 실감했습니다. 다만 한계도 짚습니다. 저는 학부 수준이라, DPI 연동으로 무거운 연산을 C 모델로 대체하거나 에뮬레이션으로 검증 속도를 끌어올려 본 경험은 없습니다. 그래서 선택적 덤프로 줄인 경험을 토대로, 그 역량을 더 키우려 합니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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