이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
CMOS 기본 개념은 학부 반도체 회로 수업에서 체계적으로 배웠습니다. CMOS 인버터에서 PMOS와 NMOS의 상보적 동작이 왜 정적 전력을 이론적으로 0에 가깝게 만드는지부터 이해하면서, 실제 소자에서 서브스레숄드 전류와 누설 전류가 발생하는 이유도 배웠습니다.
NAND와 NOR 게이트의 PMOS 직렬·병렬 구조 차이가 상승 전환과 하강 전환 속도에 영향을 주기 때문에, 타이밍 설계에서 게이트 선택이 중요합니다. 팬아웃 증가에 따른 드라이브 강도 설계를 배우면서 버퍼 삽입 판단 기준이 생겼습니다. 동적 전력이 αCVf² 에 비례한다는 관계를 이해하면 전력 최적화에서 클럭 주파수·공급 전압·스위칭 활성도 중 어느 인자를 조정할지 방향이 잡힙니다.
이 기반 개념들이 디지털 설계 전반의 판단 틀로 작동하고 있습니다.
CMOS 기본 개념에서 한계와 막힘을 짚은 건 단일 게이트 분석에서 복잡한 회로로 넘어갈 때 분석이 어려워진 경험이었습니다. 인버터와 NAND 게이트까지는 트랜지스터 수준에서 동작을 따라갈 수 있었는데, 게이트 여러 개가 연결된 회로에서는 각 트랜지스터의 상태를 동시에 추적하기 어려웠습니다.
단일 게이트 이해에서 회로 전체 분석으로 넘어가는 데 추상화 수준을 올려야 한다는 걸 이해했습니다. 게이트 레벨로 회로를 보는 방식이 트랜지스터 레벨 분석보다 실용적인 이유를 경험하게 됐습니다.
개별 요소 이해와 시스템 분석은 다른 추상화 수준에서 이뤄진다는 결이 남아 있습니다. 추상화 수준을 올리는 것이 복잡한 회로를 다루는 방법입니다.
CMOS 기본 개념에서 다음 결로 이어진 건 소자 물리와 회로 동작을 연결해서 이해한 경험이었습니다. 인버터가 동작하는 원리는 수업에서 배웠는데, 왜 PMOS가 논리 '1'을 구동하고 NMOS가 '0'을 구동하는 방식이 더 효율적인지는 처음에 직관적으로 이해되지 않았습니다.
PMOS의 소수 캐리어 특성과 NMOS의 전자 이동도가 다르다는 소자 물리 배경을 배운 뒤에야 회로 구조의 이유가 연결됐습니다. 회로 설계 선택에는 소자 물리적 이유가 있고 그 이유를 알면 구조가 왜 그렇게 됐는지를 이해할 수 있다는 결이 생겼습니다.
이후에는 회로 구조를 배울 때 왜 이렇게 만들었는지를 소자 수준에서 찾아보는 방식이 자리 잡았습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 공정설계 면접관이 던질 가능성이 높은 후속 질문.
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