이 질문 뒤에 면접관이 확인하려는 것은 따로 있습니다.
학부 아날로그 IC 설계 수업에서 CMOS 이미지 센서(CIS) 픽셀 구조를 분석하는 프로젝트를 진행했습니다. 4T 픽셀 구조에서 전하 전송 효율이 이미지 품질에 직접 영향을 준다는 걸 배웠습니다. 리드아웃 회로에서 상관 이중 샘플링(CDS)이 kTC 노이즈를 억제하는 원리를 시뮬레이션으로 확인했습니다.
칼럼 ADC 설계에서는 변환 속도와 해상도 트레이드오프가 있고, 이미지 센서에서는 저전력 ADC가 중요하다는 것도 알았습니다. 전원 공급 노이즈가 픽셀 출력에 영향을 줄 수 있어 디커플링 설계가 중요하다는 것도 배웠습니다. 이후 저는 아날로그 신호 처리 회로를 볼 때 노이즈 소스를 먼저 확인하는 습관이 생겼습니다.
감도와 노이즈 사이의 균형이 이미지 센서 설계의 핵심이라는 걸 그때 배웠습니다.
CMOS 이미지 센서 설계에서 지표가 분명해진 건 잡음 수치를 설계 목표로 정하고 회로를 분석한 경험이었습니다. 4T 픽셀 구조를 분석할 때 각 트랜지스터가 어떤 잡음 원인에 기여하는지를 먼저 정리했습니다.
Reset 잡음을 줄이기 위해 Correlated Double Sampling(CDS)이 쓰인다는 구조를 이해하고, CDS가 특정 잡음을 어느 수준까지 줄이는지를 수식으로 확인했습니다. 회로 설계 목표는 막연한 방향이 아니라 줄여야 하는 잡음의 종류와 수치로 표현될 때 분석 방향이 잡힌다는 결이 생겼습니다.
이후에는 회로 설계를 배울 때 어떤 수치를 목표로 하는지를 먼저 확인하는 방식이 자리 잡았습니다.
CMOS 이미지 센서에서 검증 결로 이어진 경험은 시뮬레이션으로 픽셀 회로 동작을 확인한 케이스였습니다. 4T 픽셀 구조의 동작을 수업 과제에서 SPICE 시뮬레이션으로 확인했습니다. 각 트랜지스터의 신호 타이밍을 시뮬레이션 파형에서 보면서 이론 설명이 실제 파형과 어떻게 연결되는지를 확인했습니다.
Reset 단계와 Signal 단계에서 플로팅 디퓨전의 전압 변화를 파형으로 확인했고, CDS로 두 단계의 차이를 취하는 구조가 잡음을 줄이는 방식이라는 걸 시각적으로 이해했습니다.
이론 설명이 시뮬레이션 파형으로 확인될 때 회로 동작 이해가 다른 수준이 된다는 결이 그 경험에서 생겼습니다.
답변에서 흔히 빠지는 것들 — 빠져 있으면 꼬리질문이 깊어집니다.
이 질문에 이어 삼성전자 반도체 회로설계 면접관이 던질 가능성이 높은 후속 질문.
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