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채널 시뮬레이션과 이퀄라이제이션으로 SerDes 설계 기초 결
고속 SerDes 설계에 대한 도메인 경험은 학교 졸업 설계에서 10Gbps 급 직렬 인터페이스 송수신기 구조를 설계 수준에서 구현한 것이 가장 가깝습니다. 실제 테이프아웃은 아니지만, 채널 손실 모델을 시뮬레이션으로 구성하고 이퀄라이저 설계까지 진행했습니다.
TX 측에서 3탭 FIR 프리엠퍼시스를 설계했고, RX 측에서는 CTLE를 적용해 채널 손실을 보상했습니다. 눈 다이어그램 열기(eye opening)를 BER 목표 기준으로 최적화했고, 이퀄라이제이션 강도와 전력 소모 사이의 트레이드오프를 데이터로 확인했습니다.
이 프로젝트에서 배운 가장 중요한 것은 SerDes 설계가 아날로그와 디지털의 경계에 있다는 점입니다. 디지털 프로토콜을 다루면서도 아날로그 신호 무결성을 함께 관리해야 하고, 두 도메인을 통합적으로 이해하는 것이 고속 인터페이스 설계의 핵심 역량입니다.
이 결의 특징
채널 시뮬레이션과 이퀄라이제이션으로 SerDes 설계 기초를 다진 흔적입니다. 기초 원리 학습이 설계 자신감을 만들었습니다.
이 결이 통하는 자리
기초 이해가 복잡한 설계 문제에서 빠른 진단을 가능하게 한 구체 사례가 드러날 때 통합니다. 원리 숙련이 현장 적응을 빠르게 하는 자리에서 면접관의 평가가 달라집니다.